晶体管为何不再扁平?从平面到环绕栅极的演进

晶体管从平面到FinFET再到环绕栅极,演进核心是让栅极更全面地包裹沟道以抑制泄漏。
文章以"晶体管是电压控制的开关"为起点,解释了栅极通过绝缘层下方形成沟道来控制电流的通断。当晶体管尺寸不断缩小,源漏间距过近导致短沟道效应,平面晶体管在关断时仍存在严重泄漏,功耗与发热不可接受。为解决这一问题,FinFET 将沟道做成垂直鳍片,让栅极从三面控制沟道;下一代环绕栅极(GAA)则把沟道切成极薄的纳米带,使栅极四面包裹,进一步增强了控制力,但同时也带来了原子层沉积、选择性刻蚀和三维集成等制造挑战。文章指出,晶体管形状的变迁本质上是控制与泄漏之间的博弈,未来二维材料或垂直堆叠器件可能延续这一趋势,核心原则始终是更好的控制、更少的泄漏。
晶体管本质上是开关,但当尺寸缩小到一定程度,电流泄漏成了大问题,逼着工程师把栅极从一侧包裹变成四面环绕。
晶体管:一个电压控制的开关
晶体管的基本结构可以理解为一个源极和漏极之间的通道,上方有一个栅极。给栅极施加正电压,会吸引硅中带负电的电子向上聚集,但一层薄绝缘层阻止它们到达栅极,电子便在绝缘层下方形成一条导电通道——沟道。撤去电压,电子消散,沟道消失,开关关闭。

这个机制看似简单,但随着晶体管越做越小,源极和漏极之间的距离近到即使栅极不加电压,电流也能从沟道中流过——开关关不掉了。
泄漏电流:平面晶体管的极限
短沟道效应导致栅极对沟道的控制力减弱,电流在关断状态下依然泄漏,功耗和发热变得不可接受。要解决这个问题,必须让栅极更紧密地控制沟道。

在原始的平面晶体管中,栅极只从顶部接触沟道。随着尺寸缩小,这种单面控制已不足以阻止电流泄漏。

短沟道效应(Short-Channel Effect)是指当晶体管的沟道长度缩短到与源漏耗尽区宽度可比时,栅极逐渐失去对沟道的完全掌控。具体表现为:阈值电压随沟道长度减小而下降(阈值电压滚降),关断电流(亚阈值泄漏)显著增大,以及漏极电压对沟道电势的影响增强(漏致势垒降低,DIBL)。其物理根源在于源极和漏极的电场"越过"了栅极的控制,直接在沟道中形成导电通路。短沟道效应并非单纯由工艺缺陷引起,而是器件按比例缩小后静电学上的固有难题,因此仅靠改进光刻或掺杂工艺无法根治,必须从器件结构上增强栅极对沟道的静电控制——这正是 FinFET 与 GAA 出现的根本动因。
FinFET:三面栅极的第一次革命
FinFET 将沟道挤压成垂直的薄鳍片,栅极像帐篷一样覆盖在鳍片上方,从三个侧面控制沟道。这种结构大幅提升了栅极的控制力,有效抑制了短沟道效应,成为延续摩尔定律的关键技术。

FinFET 的成功证明了立体结构的价值,但工程师并未止步——如果三面不够,那就四面。
环绕栅极:四面包裹的终极方案
下一代技术称为环绕栅极(Gate-All-Around,GAA)。它将沟道切成极薄的带状(nanosheet),栅极完全包裹住这些带状沟道,从顶部、底部和两侧同时控制。这要求新的材料体系和制造工艺,例如在硅锗与硅交替层中选择性刻蚀,以释放出悬空的硅带。
GAA 进一步提升了栅极控制能力,允许更小的沟道长度和更低的泄漏电流。从平面到 FinFET 再到 GAA,晶体管的演进逻辑始终一致:让栅极离沟道更近、包裹得更全面。
工程挑战与未来
GAA 的制造难度显著增加,涉及原子层沉积、选择性刻蚀和三维集成等复杂步骤。此外,堆叠多个沟道层可以增加驱动电流,但热管理和寄生电容问题仍需优化。
晶体管的形状变迁,本质上是控制与泄漏之间的博弈。当平面结构走到尽头,立体包裹成为必然。未来,二维材料或垂直堆叠器件可能继续这一趋势,但核心原则不变:更好的控制,更少的泄漏。
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